量子アニーリングとCMOSアニーリングはどう違う？

　量子アニーリングの商用機（D-Wave）とCMOSアニーリング試作機の違いで特に注目したいのは、スケーラビリティの部分だ。量子アニーリングの商用機では現在のところ1素子で512量子ビットまでの処理なので、2の512乗通りの可能性の中から、現実解を、数ミリ秒で導き出せる。

　一方、今回の試作機は2の20480乗通りの可能性の中から同程度の時間で現実解を導けることになる。CMOSアニーリング試作機は現在65ナノメートルプロセスという数世代前のプロセスを使っており、最新14ナノメートルプロセスで作れば16×（10の6乗）個のスピンがシミュレートできることになる。さらにチップを並列化すれば、さらに1兆スピンといった大規模化も可能とされている。

　また処理に使われる電力は量子アニーリングの方が低いと考えられるのだが、その利点をはるかに上回る冷却電力が使われることに注意したい。D-Waveのプロセッサは0.02ケルビン（K：絶対温度）という極低温で動作する超電導素子だ。冷却のための設備コストとランニングコストはかなり大きくなるだろう。

　一方、CMOSアニーリングは、一般的なLSIと同様のチップだ。PCやサーバの周辺機器のような形でオフィスの中に普通に置いておけるようなものになりそうだ。

　なお、日立ではSG3と呼ばれる近似アルゴリズムを、Core i5（1.87GHz、10ワット／コア）CPU上で実行したときのエネルギー効率の比較を行った。SG3と同程度の精度の解を得るために必要な時間でCMOSアニーリングを行い、同じ問題を同程度の精度で解いたときに必要としたエネルギー効率を比較した。図5に見るように、エネルギー効率は20480スピン（パラメータ数と同じ）で1800倍を記録しており、その効率はスピン数＝問題規模に応じて上がっていくことが分かった。

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図5 汎用CPUでの近似アルゴリズム実行の場合とのエネルギー効率差。【条件】ランダムに生成された組み合わせ最適化問題、同じ解精度になる場合のエネルギーを比較する。イジングチップ：VDD=1.1、100-MHz、10回実行し最も精度の高い解を選択する。近似アルゴリズム：SG3をCore i5、1.87GHz、10ワット／コア上で実行（出典：日立製作所）